 課程目標(biāo) |
Cadence培訓(xùn)初級到中級班主要為您介紹從原理圖輸入到印刷電路板光繪制造文件輸出的全線PCB設(shè)計(jì)流程，通過講課及上機(jī)練習(xí)相結(jié)合的方式完成Cadence的原理圖工具Orcad、PCB工具Allegro以及相應(yīng)的建庫工具的使用方法的系統(tǒng)培訓(xùn)。通過培訓(xùn)學(xué)員可掌握先進(jìn)的Allegro
Cadence PCB設(shè)計(jì)流程，完成PCB設(shè)計(jì)。 |
| 培養(yǎng)對象 |
從事硬件開發(fā)的所有人員，以及具有一定基礎(chǔ)的高年級本科生或者碩、博士研究生。 |
| 班級規(guī)模及環(huán)境 |
為了保證培訓(xùn)效果，增加互動(dòng)環(huán)節(jié)，我們堅(jiān)持小班授課，每期報(bào)名人數(shù)限5人，多余人員安排到下一期進(jìn)行。 |
| 質(zhì)量保障 |
1、培訓(xùn)過程中，如有部分內(nèi)容理解不透或消化不好，可免費(fèi)在以后培訓(xùn)班中重聽；
2、培訓(xùn)結(jié)束后免費(fèi)提供一個(gè)月的技術(shù)支持，充分保證培訓(xùn)后出效果；
3、培訓(xùn)合格學(xué)員可享受免費(fèi)推薦就業(yè)機(jī)會(huì)。 |
| 時(shí)間地點(diǎn) |
上課地點(diǎn)：【【上海】：同濟(jì)大學(xué)(滬西)/新城金郡商務(wù)樓(11號線白銀路站) 【深圳分部】：電影大廈(地鐵一號線大劇院站)/深圳大學(xué)成教院
【北京分部】：北京中山/福鑫大樓 【南京分部】：金港大廈(和燕路) 【武漢分部】：佳源大廈（高新二路） 【成都分部】：領(lǐng)館區(qū)1號（中和大道）
近開課時(shí)間(周末班/連續(xù)班/晚班）：Cadence初中級開課：2025年4月7日............................ |
| 學(xué)時(shí)和費(fèi)用 |
★課時(shí)：
共5天，總計(jì)30學(xué)時(shí);
◆外地學(xué)員：代理安排食宿（需提前預(yù)定）
☆合格學(xué)員免費(fèi)頒發(fā)相關(guān)資格證書，提升您的職業(yè)資質(zhì)
作為早專注于嵌入式培訓(xùn)的專業(yè)機(jī)構(gòu)，曙海嵌入式提供的證書得到本行業(yè)的廣泛認(rèn)
可，學(xué)員的能力得到大家的認(rèn)同。
☆合格學(xué)員免費(fèi)推薦工作
★實(shí)驗(yàn)設(shè)備請點(diǎn)擊這兒查看★ |
| 師資團(tuán)隊(duì) |
◆【趙老師】
8年來一直從事FPGA數(shù)字電路設(shè)計(jì)，高速DSP軟硬件的開發(fā)，高速PCB，Layout設(shè)計(jì)經(jīng)驗(yàn)非常豐富。
精通Allegro cadence和candence SPECCTRAQuest等信號完整性仿真，精通高速PCB
SI仿真、Altium Designer以及PADS工具 。成功開發(fā)了多個(gè)高速DSP和FPGA結(jié)合的高難度項(xiàng)目。
◆【黃老師】
有9年的FPGA和DSP系統(tǒng)硬件開發(fā)經(jīng)驗(yàn),5年視頻和圖像處理領(lǐng)域的高速DSP系統(tǒng)硬、軟件和FPGA系統(tǒng)的設(shè)計(jì)和開發(fā)經(jīng)驗(yàn)，高速系統(tǒng)設(shè)計(jì)經(jīng)驗(yàn)非常豐富，精通Allegro
cadence和candence SPECCTRAQuest等信號完整性仿真，精通高速PCB SI仿真工具以及PADS,Altium
Designer等PCB設(shè)計(jì)工具。
更多師資力量請參見曙海教育師資團(tuán)隊(duì)，請點(diǎn)擊這兒查看。 |
| 課程進(jìn)度安排 |
| 課程大綱 |
學(xué)習(xí)目標(biāo)及要求 |
| 學(xué)習(xí)使用ORCAD 軟件進(jìn)行原理圖的制作，電路圖的零件設(shè)計(jì)、使用
Allegro 軟件進(jìn)行 PCBLayout ， PCB 封裝制作、高速布線規(guī)則設(shè)置、出 gerber 文件應(yīng)用范圍：制作高速線路板（如：電腦主板、顯卡、交換機(jī)主板等）. |
第一階段 |
1 OrCAD Capture CIS基本設(shè)計(jì)流程
OrCAD Capture CIS Basic Board Design
Flow
2 設(shè)計(jì)輸入 Design Entry
2.1 創(chuàng)建原理圖工程及設(shè)置工作環(huán)境
2.2 工程管理器簡介
2.3 創(chuàng)建元件庫及元件
2.4 創(chuàng)建非規(guī)則圖形元件
2.5 創(chuàng)建及使用多部分元件
2.6 使用電子數(shù)據(jù)表創(chuàng)建零件
2.7 添加元件庫及放置元件
2.7.1 放置普通元件
2.7.2 放置電源和地
2.8 在同一個(gè)頁面內(nèi)創(chuàng)建電氣互聯(lián)
2.8.1 使用wire
2.8.2 使用net alias
2.9 在不同頁面之間創(chuàng)建電氣互聯(lián)
2.10 編輯原理圖的基本操作
2.10.1 選擇元件
2.10.2 移動(dòng)元件
2.10.3 旋轉(zhuǎn)元件
|
第二階段 |
3 從原理圖到PCB 工具使用
3.1 Introduction to Board Layout
3.2 Mainstream Board Design
3.3 Design Synchronization
3.4 Netlist Files
4 原理圖高級設(shè)計(jì)技巧
4 使用Edit Browse選項(xiàng)的技巧
4.1.1 使用Parts選項(xiàng)
2.1.2 使用Nets選項(xiàng)
4.2 在原理圖中搜索特定元素
4.2.1 搜索元件
4.2.2 查找網(wǎng)絡(luò)
4.3 原理圖頁相關(guān)操作技巧
4.4 添加Footprint屬性
4.4.1 單個(gè)添加
4.4.2 批量添加
4.5 生成Netlist
4.6 生成元件清單
|
第三階段 |
5 PCB設(shè)計(jì)準(zhǔn)備：Allegro環(huán)境、PCB布局布線
5.1 Allegro User Interface
5.2 Managing the Allegro Work
Environment
5.3 Padstack Designer
5.4 Component Symbols
5.5 Board Design Files
5.6 Importing Logic Information
into Allegro
5.7 Setting Design Constraints
5.8 Component Placement
5.9 Routing
6 建立元件庫 PCB Librarian Expert
6.1 Design Processes and Library Models
6.2 Setting Up a Build Area
6.3 The Symbol View
6.4 The Chips View
6.5 The Part Table View
6.6 Importing Text Files
|
第四階段 |
PCB數(shù)據(jù)后處理：覆銅、生產(chǎn)加工數(shù)據(jù)輸出
7.1 Preparing for Post Processing
7.2 Creating Silkscreens
7.3 Generating Artwork
7.4 The Aperture File
7.5 Film Control
7.6 Generating Gerber Files
7.7 Creating Fabrication Drawings
7.8 Generating an NC Drill
File
7.9 Creating the Parameters
File
7.10 Creating Assembly Drawings
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第五階段 項(xiàng)目實(shí)戰(zhàn)，一步步手把手教你完成一個(gè)完整的DSP6713開發(fā)板 |
DSP6713開發(fā)板設(shè)計(jì)主要內(nèi)容有:
1.DSP6713開發(fā)板功能方框圖。
2.元件庫建立管理
3.DSP6713開發(fā)板原理圖設(shè)計(jì)
4.DSP6713開發(fā)板PCB疊層結(jié)構(gòu)介紹
5.DSP6713開發(fā)板PCB布局以及布線設(shè)計(jì)
6.出Gerber文件
7.DSP6713開發(fā)板PCB設(shè)計(jì)實(shí)例 |
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